Balanced gray codes

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Évaluation

Difficulté
5/5
Temps estimé
Plus d'une semaine
Accessibilité débutants
20/100
Type d'issue
Fonctionnalité
Clarté
À clarifier
Activité
À l'abandon
Domaine
embedded-iot

Piste de recherche

Commencez par l’article Wikipédia lié et les articles indiqués afin de déterminer un algorithme Gray-code pratique et équilibré adapté à SystemVerilog. Le payload ne nomme aucun fichier source, aucun test ni aucun point d’entrée d’implémentation ; pour considérer le travail terminé, il faudrait un algorithme convenu et son intégration dans le dépôt.

Rédigé par le modèle d'indexation à partir du texte de l'issue.

Description

help wanted

There are methods to produce balanced gray codes: gray codes where the transitions of each bit are evenly distributed across the mapping.

Wikipedia entry describes it better in more concrete mathematical terms.

One algorithm I thought of:

  • Generate a gray code hypercube -- a graph where each vertex is a binary code, and it is connected to all vertices which are 1 bit different (i.e. for bit width of 4, there are 4 adjacent vertices to 0: 1, 2, 4, 8)
  • Find hamiltonian cycles in the graph
  • Check hamiltonian cycles for balance, pick the first balanced one

I read some papers about it, but I don't have an algorithm that would be simple enough to implement in SystemVerilog.

Langage dominant
SystemVerilog
Étoiles
4
Forks
1
Métriques de merge des PR
Aucune PR mergée en 30 j

Préparer son environnement

Ce projet ne fournit ni conteneur de développement, ni Dockerfile, ni guide de contribution : l'installation est à votre charge. Commencez par son README, et consultez notre guide de la première contribution pour les étapes générales.

Par où commencer

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  4. Ouvrez une pull request qui référence le numéro de l'issue.

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