ApolloLakeFspBinPkg[MR6] broken MPS with `PcieRpHotPlug = 1`
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评估
- 难度
- 5/5
- 预计耗时
- 一周以上
- 新手友好度
- 15/100
- Issue 类型
- 缺陷
- 描述清晰度
- 需要澄清
- 活跃度
- 停滞
- 技术栈
- c
- 领域
- embedded-iot
调研方向
首先，在启用 PcieRpHotPlug 的情况下复现该问题，并比较相应 root port 中的 DCAP Max Payload Size Supported 和 DCTL Max Payload Size 值。没有指定源文件或测试；要视为完成，需要一个已修复的二进制文件或能够解决不一致 MPS 设置的公开发布代码。
由索引模型根据 Issue 内容生成。
描述
Enabling PcieRpHotPlug (or rather leaving it enabled) causes inconsistent MPS settings in the respective RPs:
- DCAP Max Payload Size Supported will be cleared to 0 (128B)
- DCTL Max Payload Size will be set to 1 (256B)
Whether or not the DCAP change is intentional is impossible to say. As usual there is no documentation about FSP. It's also possible that DCAP is written by accident (it's RW/O).
That DCTL is written at all is another issue.
Please issue a fixed binary or release the code to the public so we can work on a proper implementation (which would be much less expensive for Intel's hardware customers that are currently forced into beta testing your software).
- 主要语言
- C
- 星标
- 366
- 派生
- 143
- PR 合并指标
- 30 天内没有已合并 PR
环境准备
- 没有 Dockerfile 或 Docker Compose 文件
- 没有 Pull Request 模板
- 阅读贡献指南
从这里开始
- 先读完整个 Issue，再读项目的贡献指南。
- 在 Issue 下留言说明你要接手 —— 这能避免两个人做同样的事。
- Fork 仓库，在一个分支上完成修改。
- 提交 Pull Request，并在描述里引用这个 Issue 编号。
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ArrowLakeS FSP: TmeEnable = 1 leaves TME inactive on Core Ultra 9 285K (single-key TME, no TME-MK)未关闭
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