ram inferrence improvements
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Valutazione
- Difficoltà
- 5/5
- Tempo stimato
- Più di una settimana
- Idoneità per principianti
- 20/100
- Tipo di issue
- Funzionalità
- Chiarezza
- Da chiarire
- Stato di attività
- Ferma
- Ambito
- embedded-iot
Direzione di ricerca
Inizia tracciando le configurazioni di FIFO a larghezza mista e di RAM DPR mista, quindi esamina come viene attualmente gestita l’inferenza della RAM di Vivado. Analizza il requisito di registrazione dell’uscita quando la larghezza del lato di scrittura è maggiore di quella del lato di lettura, ed esamina l’assenza di SCFIFOs. Il lavoro è completato quando il comportamento è stato compreso e per questi casi è stata definita una soluzione indipendente dalla piattaforma.
Scritto dal modello di indicizzazione a partire dal testo della issue.
Descrizione
I'd like to work out a better solution in the following areas:
- Mixed width FIFOs. These behave strangely in some cases (write side > read side) and we may not be properly meeting the vivado rules of only using "auto" when the sizes are matched.
- in the mixed DPR config, when write side > read_side I needed to register the read output in order for the ram to be picked up correctly by vivado.
- We don't have SCFIFOs wrapped right now
I need to spend some more time investigating this and working out a better solution to these things, ideally one more platform independent or wrapped in an independent way
- Lingua principale
- VHDL
- Stelle
- 24
- Fork
- 2
- Merge medio
- 49m
- PR unite (30g)
- 5
Preparare l'ambiente
- Nessun Dockerfile né file Docker Compose
- Nessun modello di pull request
- Leggi la guida per i contributori
Come iniziare
- Leggi tutta la issue e poi la guida ai contributi del progetto.
- Commenta sulla issue per dire che te ne occupi tu — evita che due persone facciano lo stesso lavoro.
- Fai un fork del repository e lavora su un branch.
- Apri una pull request che faccia riferimento al numero della issue.
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