ram inferrence improvements
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Evaluación
- Dificultad
- 5/5
- Tiempo estimado
- Más de una semana
- Aptitud para principiantes
- 20/100
- Tipo de issue
- Nueva funcionalidad
- Claridad
- Necesita aclaración
- Estado de actividad
- Estancado
- Área
- embedded-iot
Línea de trabajo
Comienza rastreando las configuraciones de FIFO de ancho mixto y de RAM DPR mixta, y revisando cómo se gestiona actualmente la inferencia de RAM de Vivado. Investiga el requisito de registrar la salida cuando el ancho del lado de escritura es mayor que el del lado de lectura, y examina la ausencia de SCFIFOs. Se considera terminado cuando se haya comprendido el comportamiento y se haya definido una solución independiente de la plataforma para estos casos.
Escrito por el modelo de indexación a partir del texto del issue.
Descripción
I'd like to work out a better solution in the following areas:
- Mixed width FIFOs. These behave strangely in some cases (write side > read side) and we may not be properly meeting the vivado rules of only using "auto" when the sizes are matched.
- in the mixed DPR config, when write side > read_side I needed to register the read output in order for the ram to be picked up correctly by vivado.
- We don't have SCFIFOs wrapped right now
I need to spend some more time investigating this and working out a better solution to these things, ideally one more platform independent or wrapped in an independent way
- Lenguaje dominante
- VHDL
- Estrellas
- 24
- Forks
- 2
- Merge medio
- 31 min
- PR fusionados (30 d)
- 8
Preparar el entorno
- Sin Dockerfile ni archivo de Docker Compose
- Sin plantilla de pull request
- Leer la guía de contribución
Primeros pasos
- Lee el issue completo y luego la guía de contribución del proyecto.
- Comenta en el issue que vas a ocuparte — evita que dos personas hagan lo mismo.
- Haz un fork del repositorio y trabaja en una rama.
- Abre un pull request que haga referencia al número del issue.
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