Define explicit volatile memory access for device registers
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评估
调研方向
The issue says no volatile access contract was found in the inspected lexer, parser and memory API, but names no files or tests. Read those areas first and discuss the design with @LunaStev before implementation. Done means agreeing on the API or syntax, widths, alignment, target restrictions and observable access guarantees, then verifying optimized output and unsupported request diagnostics.
由索引模型根据 Issue 内容生成。
描述
Motivation
No source-level volatile load/store contract was found in the inspected lexer, parser and memory API. LLVM ordinary loads/stores and inline-assembly memory clobbers do not constitute a typed volatile access API.
Scope
Decide API or syntax, allowed widths/alignment and exact volatile access guarantees; keep volatile distinct from atomicity and synchronization. This is an optional systems capability, not a regression or proof of kernel suitability.
Completion criteria
- Approve the source/API form and specify supported access widths, alignment and target restrictions.
- Define preservation of observable accesses without claiming atomicity or synchronization.
- Verify generated volatile accesses under optimization and diagnose unsupported requests explicitly.
Design required. Please mention @LunaStev to discuss the design before starting implementation.
- 主要语言
- Rust
- 星标
- 56
- 派生
- 21
- 平均合并
- 23 小时 20 分钟
- 30 天内合并 PR
- 45
环境准备
从这里开始
- 先读完整个 Issue，再读项目的贡献指南。
- 在 Issue 下留言说明你要接手 —— 这能避免两个人做同样的事。
- Fork 仓库，在一个分支上完成修改。
- 提交 Pull Request，并在描述里引用这个 Issue 编号。
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