sidecar FPGA needs to provide a method of clearing out the TX FIFO registers
オープン
@Aaron-Hartwig がすでに取り組んでいます。
2026年1月13日 から。
評価
この issue はまだ評価されていません。
説明
see https://github.com/oxidecomputer/hubris/issues/2326 for description of the fallout here. This register is reported as ReadOnly so we need something here to allow this to be cleared or change the design such that a NACK doesn't strand bytes in an un-clearable FIFO
- 主要言語
- VHDL
- スター
- 24
- フォーク
- 2
- PR マージ指標
- 30日以内にマージされた PR はありません
環境構築
- Dockerfile・Docker Compose ファイルなし
- プルリクエストのテンプレートなし
- コントリビューションガイドを読む
はじめの一歩
- issue を最後まで読み、次にプロジェクトのコントリビューションガイドを読みます。
- 着手することを issue にコメントします — 二人が同じ作業をするのを防げます。
- リポジトリをフォークし、ブランチを切って変更します。
- issue 番号を参照したプルリクエストを送ります。
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