[top,dv] Connect all chip ports or document the tie-offs
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評価
- 難易度
- 4/5
- 見積もり時間
- 3〜5日
- 初心者へのやさしさ
- 48/100
- issue の種類
- ドキュメント
- 明瞭さ
- おおむね明確
- 活発さ
- 活発
- 領域
- embedded-iot
調査の方向性
Start by reading tb.sv and the top_chip_system port declarations, then review the changes from issue #637. Identify which listed ports need an agent, interface, or model and which are unused on this chip; document the tie-offs for unused ports. Done when every port has one of those connections or a documented tie-off.
索引モデルが issue の本文から書いたものです。
説明
TOP_TB_COMPLETED: every top_chip_system port needs an agent, an interface or a model, or a documented tie-off when it is unused on this chip.
Tied off in tb.sv with no issue yet:
- External mailbox AXI port and
mailbox_ext_irq_o rest_of_chipAXI port andethernet_irq_i- New ports from #637
- 主要言語
- SystemVerilog
- スター
- 45
- フォーク
- 22
- 平均マージ
- 2日 4時間
- マージ済み PR（30日）
- 9
環境構築
このプロジェクトには開発コンテナ、Dockerfile、コントリビューションガイドがありません。まず README を読み、一般的な手順ははじめてのコントリビューションガイドを参照してください。
はじめの一歩
- issue を最後まで読み、次にプロジェクトのコントリビューションガイドを読みます。
- 着手することを issue にコメントします — 二人が同じ作業をするのを防げます。
- リポジトリをフォークし、ブランチを切って変更します。
- issue 番号を参照したプルリクエストを送ります。
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