[v2025.1]Vitis_Platform_Creation/Design_Tutorials/04_Edge_VCK190_DFX/ref_files/step3_validate
まだ誰も着手していません。
評価
- 難易度
- 4/5
- 見積もり時間
- 3〜5日
- 初心者へのやさしさ
- 25/100
- issue の種類
- バグ
- 明瞭さ
- 説明が足りない
- 活発さ
- 停滞
調査の方向性
Start by reviewing the aie_work/_x/link/vivado/vpl/prj/prj.runs/impl_1/runme.log from step3_validate, then inspect dr_routed_timing.dcp and dr_timing_summary.rpt for the reported path. The issue is resolved when make aie_adder_hw completes without the VPL timing failure.
索引モデルが issue の本文から書いたものです。
説明
Hello,
I ran step1 and step2 successfully, but when execute "make aie_adder_hw" in step3_validate, I ran into the following error:
===>The following messages were generated while Compiling (bitstream) accelerator binary: adder Log file: /home/my/worktree/Viti-Tutorials-2025.1/Vitis_Platform_Creation/Design_Tutorials/04_Edge_VCK190_DFX/ref_files/step3_validate/aie_work/_x/link/vivado/vpl/prj/prj.runs/impl_1/runme.log :
ERROR: [VPL 101-2] design did not meet timing - Design failed to meet timing.
Failed timing checks (paths):
{versal_dfx_platform_i/IsoReset/U0/ACTIVE_LOW_PR_OUT_DFF[0].FDRE_PER_N/C --> versal_dfx_platform_i/VitisRegion/clk_wizard_0/inst/clock_primitive_inst/MBUFGCE_CE_1_DLY_inst/clr_rise_det_reg/PRE}
Please check the routed checkpoint (dr_routed_timing.dcp) and timing summary report (dr_timing_summary.rpt) for more information.
ERROR: [VPL 101-3] sourcing script /home/my/worktree/Viti-Tutorials-2025.1/Vitis_Platform_Creation/Design_Tutorials/04_Edge_VCK190_DFX/ref_files/step3_validate/aie_work/_x/link/vivado/vpl/scripts/impl_1/_full_write_device_image_pre.tcl failed
Could you please provide some suggestions on how to fix it?
Best Regards
- 主要言語
- C
- スター
- 1.6k
- フォーク
- 626
- PR マージ指標
- 30日以内にマージされた PR はありません
環境構築
このプロジェクトには開発コンテナ、Dockerfile、コントリビューションガイドがありません。まず README を読み、一般的な手順ははじめてのコントリビューションガイドを参照してください。
はじめの一歩
- issue を最後まで読み、次にプロジェクトのコントリビューションガイドを読みます。
- 着手することを issue にコメントします — 二人が同じ作業をするのを防げます。
- リポジトリをフォークし、ブランチを切って変更します。
- issue 番号を参照したプルリクエストを送ります。
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