Extra sclk inserted before a STOP by i2c link layer
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Valutazione
- Difficoltà
- 3/5
- Tempo stimato
- 1-2 giorni
- Idoneità per principianti
- 35/100
- Tipo di issue
- Bug
- Chiarezza
- Abbastanza chiara
- Stato di attività
- Ferma
- Ambito
- embedded-iot
Direzione di ricerca
Inizia tracciando la generazione di STOP del livello di collegamento I2C e confrontane il comportamento con la forma d’onda allegata, concentrandoti sulla fase ACK e sul clock aggiuntivo prima di STOP. Il lavoro è completato quando STOP viene generato durante il periodo indicato con il clock alto, anziché sul clock successivo, senza inserire un SCLK aggiuntivo.
Scritto dal modello di indicizzazione a partire dal testo della issue.
Descrizione
Since we've NACK'd on reads or are doing writes, this is benign in that it causes no bad behavior but is incorrect.
Red marker is the ACK phase. Green marker is the CLK high period where the STOP should be generated but instead it is generated at the next clock.
- Lingua principale
- VHDL
- Stelle
- 24
- Fork
- 2
- Metriche di merge delle PR
- Nessuna PR unita negli ultimi 30g
Preparare l'ambiente
- Nessun Dockerfile né file Docker Compose
- Nessun modello di pull request
- Leggi la guida per i contributori
Come iniziare
- Leggi tutta la issue e poi la guida ai contributi del progetto.
- Commenta sulla issue per dire che te ne occupi tu — evita che due persone facciano lo stesso lavoro.
- Fai un fork del repository e lavora su un branch.
- Apri una pull request che faccia riferimento al numero della issue.
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