Extra sclk inserted before a STOP by i2c link layer
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Evaluación
- Dificultad
- 3/5
- Tiempo estimado
- 1-2 días
- Aptitud para principiantes
- 35/100
- Tipo de issue
- Error
- Claridad
- Bastante claro
- Estado de actividad
- Estancado
- Área
- embedded-iot
Línea de trabajo
Empieza trazando la generación de STOP de la capa de enlace I2C y compara su comportamiento con la forma de onda adjunta, centrándote en la fase ACK y en el reloj adicional antes de STOP. Se considera terminado cuando STOP se genere durante el período indicado de nivel alto del reloj, en lugar de hacerlo en el reloj siguiente, sin insertar un SCLK adicional.
Escrito por el modelo de indexación a partir del texto del issue.
Descripción
Since we've NACK'd on reads or are doing writes, this is benign in that it causes no bad behavior but is incorrect.
Red marker is the ACK phase. Green marker is the CLK high period where the STOP should be generated but instead it is generated at the next clock.
- Lenguaje dominante
- VHDL
- Estrellas
- 24
- Forks
- 2
- Métricas de merge de PR
- Sin PR fusionados en 30 d
Preparar el entorno
- Sin Dockerfile ni archivo de Docker Compose
- Sin plantilla de pull request
- Leer la guía de contribución
Primeros pasos
- Lee el issue completo y luego la guía de contribución del proyecto.
- Comenta en el issue que vas a ocuparte — evita que dos personas hagan lo mismo.
- Haz un fork del repositorio y trabaja en una rama.
- Abre un pull request que haga referencia al número del issue.
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