consider consolidating sidecar b/c/d fpga images
@Aaron-Hartwig がすでに取り組んでいます。
2024年10月18日 から。
評価
この issue はまだ評価されていません。
説明
R11 had an issue where b images got put in to the c/d slots due to human-in-the-loop errors.
The major change here is that the C+ images have a 36th ignition target.
This is tricker because the FPGA on sidecar knows nothing about its version as it can't see the version resistors. We could, however have the SP set which sidecar it is after fpga programming and build functions in the fpga to disable this feature on older sidecars.
- 主要言語
- VHDL
- スター
- 24
- フォーク
- 2
- 平均マージ
- 31分
- マージ済み PR（30日）
- 8
環境構築
- Dockerfile・Docker Compose ファイルなし
- プルリクエストのテンプレートなし
- コントリビューションガイドを読む
はじめの一歩
- issue を最後まで読み、次にプロジェクトのコントリビューションガイドを読みます。
- 着手することを issue にコメントします — 二人が同じ作業をするのを防げます。
- リポジトリをフォークし、ブランチを切って変更します。
- issue 番号を参照したプルリクエストを送ります。
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