VUnit testcases fail if the testcase name contains a colon (SystemVerilog)
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評価
調査の方向性
Start with the attached MinimalExample.zip, especially its run.py script and minimal SystemVerilog testbench, and reproduce the failure for the testcase named "Test: Fail" alongside the passing "Test Pass" case. Compare how VUnit handles the two testcase names and trace where the colon causes the failure; done means the colon-named testcase runs successfully while the control testcase still passes.
索引モデルが issue の本文から書いたものです。
説明
I noticed that the VUnit testcases in a SystemVerilog testbench will always fail if their testcase name contains a colon. I attached a minimal example including a simple run.py script and a minimal testbench with two testcases. I tested this on two separate windows machines and got the same results on both pcs. Is this a bug in vunit or is something else wrong here?
from vunit import VUnit
# Create VUnit instance by parsing command line arguments
vu = VUnit.from_argv()
vu.add_verilog_builtins()
# Create library 'lib'
lib = vu.add_library("lib")
# Add all files ending in .sv in current working directory to library
lib.add_source_files("*.sv")
# Run vunit function
vu.main()
`include "vunit_defines.svh"
module tb_Test;
`TEST_SUITE begin
// Note: Do not place any code here (unless you are debugging
// VUnit internals).
`TEST_SUITE_SETUP begin
$display("Running test suite setup code");
end
`TEST_CASE_SETUP begin
$display("Running test case setup code");
end
`TEST_CASE("Test: Fail") begin
// This testcase always fails because there
// is a colon in its name
end
`TEST_CASE("Test Pass") begin
// This testcase will pass
// Note: There is no colon in its name
end
`TEST_CASE_CLEANUP begin
// This section will run after the end of a test case. In
// many cases this section will not be needed.
$display("Cleaning up after a test case");
end
`TEST_SUITE_CLEANUP begin
// This section will run last before the TEST_SUITE block
// exits. In many cases this section will not be needed.
$display("Cleaning up after running the complete test suite");
end
end;
// The watchdog macro is optional, but recommended. If present, it
// must not be placed inside any initial or always-block.
`WATCHDOG(1ns);
endmodule
- 主要言語
- VHDL
- スター
- 850
- フォーク
- 305
- 平均マージ
- 1日 22時間
- マージ済み PR（30日）
- 9
環境構築
- Dockerfile・Docker Compose ファイルなし
- プルリクエストのテンプレートなし
- コントリビューションガイドを読む
はじめの一歩
- issue を最後まで読み、次にプロジェクトのコントリビューションガイドを読みます。
- 着手することを issue にコメントします — 二人が同じ作業をするのを防げます。
- リポジトリをフォークし、ブランチを切って変更します。
- issue 番号を参照したプルリクエストを送ります。
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