espi: phy timing, quad I/O testing
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Valutazione
- Difficoltà
- 5/5
- Tempo stimato
- Più di una settimana
- Idoneità per principianti
- 25/100
- Tipo di issue
- Funzionalità
- Chiarezza
- Da chiarire
- Stato di attività
- Ferma
- Ambito
- embedded-iot, performance
Direzione di ricerca
Inizia esaminando il livello PHY e il design x1, 20MHz esistente, quindi valuta i parametri di temporizzazione AMD e i ritardi della scheda menzionati nell'issue. Il lavoro sarà completato quando saranno supportati i vincoli di temporizzazione I/O alla massima velocità e i test quad I/O, saranno gestiti i crossing tra domini e la documentazione sarà aggiornata.
Scritto dal modello di indicizzazione a partire dal testo della issue.
Descrizione
For now, the design is running x1 and advertises 20MHz support only
I need to do proper I/O timing constraints here to support maximum speeds. After evaluating the AMD timing parameters and our board delays I'm going to have to slightly re-tool the phy layer to run on the espi clock directly rather than at 200MHz so that we can hit the I/O delay perf we need.
This was a known possibility when I re-tooled the phy layer from the most naive original implementation, but there are a number of domain crossings and things that need to be carefully managed here and documentation updated. Since this is an enhancement vs core functionality it's been de-prioritized in favor of work to get interfaces which have no implementation up and running.
- Lingua principale
- VHDL
- Stelle
- 24
- Fork
- 2
- Metriche di merge delle PR
- Nessuna PR unita negli ultimi 30g
Preparare l'ambiente
- Nessun Dockerfile né file Docker Compose
- Nessun modello di pull request
- Leggi la guida per i contributori
Come iniziare
- Leggi tutta la issue e poi la guida ai contributi del progetto.
- Commenta sulla issue per dire che te ne occupi tu — evita che due persone facciano lo stesso lavoro.
- Fai un fork del repository e lavora su un branch.
- Apri una pull request che faccia riferimento al numero della issue.
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