Wishbone master doesn't handle `wait_until_idle()` properly
I maintainer di solito rispondono entro 1 giorno
Nessuno ha ancora preso questa issue.
Valutazione
- Difficoltà
- 1/5
- Tempo stimato
- 1-3 ore
- Idoneità per principianti
- 35/100
- Tipo di issue
- Bug
- Chiarezza
- Specificata chiaramente
- Stato di attività
- Ferma
- Ambito
- testing
Direzione di ricerca
The issue points to vunit/vhdl/verification_components/src/wishbone_master.vhd, comparing wait_until_idle() near line 94 with a similar wait near line 68. Read those sections and check how the clock edge is handled; done means wait_until_idle() waits for the appropriate rising clock edge and the Wishbone master tests cover the behavior.
Scritto dal modello di indicizzazione a partire dal testo della issue.
Descrizione
Hi,
Turns out that wishbone master BFM doesn't handle the wait_until_idle() call properly. I think it's missing a wait for clock edge.
The missing wait until rising_edge(clk) code is here:
https://github.com/VUnit/vunit/blob/master/vunit/vhdl/verification_components/src/wishbone_master.vhd#L94C1-L97C16
but you can see this wait present just a few lines above:
https://github.com/VUnit/vunit/blob/master/vunit/vhdl/verification_components/src/wishbone_master.vhd#L68C1-L71C16
- Lingua principale
- VHDL
- Stelle
- 850
- Fork
- 305
- Merge medio
- 2g 10h
- PR unite (30g)
- 7
Preparare l'ambiente
- Nessun Dockerfile né file Docker Compose
- Nessun modello di pull request
- Leggi la guida per i contributori
Come iniziare
- Leggi tutta la issue e poi la guida ai contributi del progetto.
- Commenta sulla issue per dire che te ne occupi tu — evita che due persone facciano lo stesso lavoro.
- Fai un fork del repository e lavora su un branch.
- Apri una pull request che faccia riferimento al numero della issue.
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