[BUG] Incorrect gating of FADD, FSUB (accumulate into ZA)
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Evaluación
- Dificultad
- 1/5
- Tiempo estimado
- Menos de una hora
- Aptitud para principiantes
- 48/100
- Tipo de issue
- Error
- Claridad
- Bien especificado
- Estado de actividad
- Estancado
- Stack tecnológico
- c
- Área
- documentation
Línea de trabajo
Comienza en acle.md, en la sección “ADD, SUB, BFADD, BFSUB, FADD, FSUB (accumulate into ZA)”, cerca de la línea enlazada. Compara las condiciones de gating de half-precision con los requisitos de features de las instrucciones SME referenciadas; se considera terminado cuando la documentación refleja las combinaciones de features compatibles.
Escrito por el modelo de indexación a partir del texto del issue.
Descripción
Describe the bug
In the "ADD, SUB, BFADD, BFSUB, FADD, FSUB (accumulate into ZA)" section, we guard half precision element operations using __ARM_FEATURE_SME_F16F16 only.
However, "Two ZA single-vectors of half-precision elements" and "Four ZA single-vectors of half-precision elements" encodings are available when either (FEAT_SME_F16F16 || FEAT_SME_F8F16) features are available.
- Lenguaje dominante
- Python
- Estrellas
- 129
- Forks
- 77
- Merge medio
- 8 d 12 h
- PR fusionados (30 d)
- 2
Preparar el entorno
- Sin Dockerfile ni archivo de Docker Compose
- Tiene una plantilla de pull request
- Leer la guía de contribución
Primeros pasos
- Lee el issue completo y luego la guía de contribución del proyecto.
- Comenta en el issue que vas a ocuparte — evita que dos personas hagan lo mismo.
- Haz un fork del repositorio y trabaja en una rama.
- Abre un pull request que haga referencia al número del issue.
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